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摘 要:介紹了一種基于復雜可編程邏輯器件（cpld）的120mhz高速a／d采集卡的設計方法。給出了這種采集卡的硬件原理電路和主要的軟件設計思路。采用該設計方法設計的數據采集卡具有包括負延遲觸發等多種觸發方式，具有體積小，工作可靠，控制簡單等特點。 關鍵詞:高速a／d；cpld；負延遲觸發；epm7128；ad9054 高速a／d采集技術已在許多領域得到愈來愈廣泛的應用，本文將詳細論述采用cpld技術來實現120mhz高速a／d采集卡的設計方法，該采集卡具有包括負延遲觸發在內的多種觸發方式，采用cpld復雜可編程邏輯器件（又稱fpga）epm7128sqc100－7和ad公司的高速模數轉換器（a／d）ad9054bst－135來實現。 1
程中能穩定工作，滿足設計指標要求。 0 引言 信號顯示卡是雷達嵌入式故障診斷系統中的重要組件，主要完成系統工作過程中采集信號的顯示和診斷流程的指示，是重要的人機對話窗口的執行部件。因此，顯示卡功能的好壞，直接關系到整個系統最終能否完成工作。 1 系統硬件設計與實現 如圖1所示，該顯示卡的硬件電路主要由輸入匹配網絡、模數轉換單元、時鐘產生電路、時序產生電路、控制信號產生模塊和顯示單元組成。 圖1 顯示卡硬件電路示意圖。 輸入的模擬信號經緩沖放大以后進入模數變換器ad9054，其最高采樣速率為200ms/s，具有380mhz的模擬輸入帶寬。它有兩個采集數據輸出端口(port a和port b)，可以選用單端口輸出或雙端*替乒乓輸出。a/d轉換后輸出的數據經兩路鎖存器鎖存以滿足后續存儲器的高速寫入。 如圖1所示，系統時序產生控制電路產生系統時鐘并協調系統各部分工作步驟，它根據a/d變換采樣時鐘以及a/d變換器輸出接口時序的要求，產生鎖存器的鎖存時鐘，并以適當的延遲量提供存儲器的讀寫脈沖。時序產生電路還提供地址產生器和記錄長度計數器的計數時鐘。系統初始化后，a/d
一個芯片的封裝形式為什么給出了多個不同參數？本人在做一個ad轉換器件時用到了ad9054芯片，該芯片的封裝形式中給出了多個不同參數。例如引腳寬度這一參數分別給出了0.015和0.010（單位都是inch）。不知針對此情況在確定該芯片的封裝時應如何設定參數？
基本上可以用樣片解決沒有必要用1gsps的adc，可以使用4片250msps的adc比如ad9054等等。時鐘用ad9511來產生，4個時鐘依次相移90度，這樣就可以實現1gsps的實時采樣。fpga可用可不用，前提條件是要有個比較大的fifo，比如269等等這個話題我關注很久了……老兄有興趣的話可以交流下，我的email:fobyellow@sohu.com
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