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息及工作狀態等,供pc機定時取用,同時也接收來自pc機的命令。雙口ram2 idt7130其容量為2k字節,主要用于cpu1與cpu2交換gps的同步時鐘信息。 對高速數據采集技術而言,最為重要的是系統的分辨率、精度與通過速率。特別是系統通過速率,是區別高速數據采集與一般數據采集最為關鍵的一項技術指標。在硬件的具體實現過程中,則需要考慮兩個方面:(1)a/d轉換器的轉換時間;(2)轉換后的數據存儲時間[2]。 1.1 高速a/d轉換 a/d轉換采用閃爍adc器件ad9048,其最大轉換速率為35msps,分辨率為8位。利用高速雙極工藝制造,采樣速率快,頻帶寬,無代碼遺失,輸入電容?。▋H為16pf),功耗低(為500mw)。ad9048內部時鐘鎖定比較器可使編碼邏輯電路和輸出緩沖寄存器作在35msps的高速,并避免了多數系統對取樣保持電路(s/h)和跟蹤保持電路(t/h)的需要。數字輸入、輸出及控制電平與ttl兼容。ad589和ad741、2n3906等構成穩壓可調電路,提供給9048的rb、rt接地。ad9618作為輸入緩沖放大器[3]。由于ad9048的數據輸出
系統整體結構 這種基于cpld的ccd自動增益調整驅動電路的整體結構如圖1所示,該系統共分為兩部分。第一部分為模擬/數字轉換電路,該部分采用一個轉換精度為8位的a/d轉換器來將ccd輸出的模擬電壓值轉換為數字量。第二部分為可自動調整增益的ccd驅動電路,此部分采用cpld進行配置,可自動完成增益調整及ccd驅動信號的輸出,并可為a/d轉換器提供轉換控制脈沖。 a/d轉換部分 ccd的輸出信號為模擬量,故須經a/d將其轉換成數字量,以便cpld進行處理。在本設計中,a/d轉換器采用的ad9048可工作在35msps的高速上,由cpld產生的單位轉移脈沖sp可為其提供轉換控制脈沖convert。在convert的上升沿到來后,a/d9048對ccd相應象素點上輸出的模擬電壓值進行采樣,并在convert下降沿到來之前輸出轉換結果,該結果由cpld寄存并最終得到一幀中ccd輸出的模擬電壓峰值的大小。 可自動增益的ccd驅動電路設計 此電路利用cpld設計,其內部可劃分為四個模塊(如圖2所示),整個芯片所需的時鐘由外部晶振或振蕩電路提供。 第一個分頻模塊dispart用于對外部時鐘
35MSPS編碼率;16pF輸入電容;550mW功耗;工業標準接腳分布;MIL-STD 883兼容版本
這種基于cpld的ccd自動增益調整驅動電路的整體結構如圖1所示,該系統共分為兩部分。第一部分為模擬/數字轉換電路,該部分采用一個轉換精度為8位的a/d轉換器來將ccd輸出的模擬電壓值轉換為數字量。第二部分為可自動調整增益的ccd驅動電路,此部分采用cpld進行配置,可自動完成增益調整及ccd驅動信號的輸出,并可為a/d轉換器提供轉換控制脈沖。 a/d轉換部分 ccd的輸出信號為模擬量,故須經a/d將其轉換成數字量,以便cpld進行處理。在本設計中,a/d轉換器采用的ad9048可工作在35msps的高速上,由cpld產生的單位轉移脈沖sp可為其提供轉換控制脈沖convert。在convert的上升沿到來后,a/d9048對ccd相應象素點上輸出的模擬電壓值進行采樣,并在convert下降沿到來之前輸出轉換結果,該結果由cpld寄存并最終得到一幀中ccd輸出的模擬電壓峰值的大小。 可自動增益的ccd驅動電路設計 此電路利用cpld設計,其內部可劃分為四個模塊(如圖2所示),整個芯片所需的時鐘由外部晶振或振蕩電路提供。 第一個分頻模塊disp