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3.3V Octal buffer/line driver 3-Stat...
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層收發(fā)設備，具有更高的信噪比、較低的功耗，是marvell semiconductor inc.的產(chǎn)品。(3)sram采用w25p243a。它是一種64k× 64大小的piplined的cmos高速靜態(tài)ram，是winbond electronics 公司產(chǎn)品。圖33 系統(tǒng)關鍵電路的設計 3.1 系統(tǒng)時鐘的設計由于兩個phy芯片的時鐘都為50mhz，而sram和at89818的時鐘都有75mhz，已經(jīng)屬于高速數(shù)字電路的設計，因此在設計時候要考慮信號的完整性。如圖2所示，通過緩存器74lvt244可增加時鐘的驅(qū)動能力，產(chǎn)生2個同相、延遲極小并且一致的時鐘輸出給2個phy，可保證信號的完整性。 另外在pcb設計時也應該讓高速信號走線盡量短，以保證系統(tǒng)信號的完整性設計。 3.2 mcu與eeprom、at89818之間控制的系統(tǒng)設計 mcu與at93c46連接如圖3所示。mcu通過edo、edi、esk、ecs可對at93c46進行讀寫；同時，edo、edi、esk、ecs也分別與at89818的do、di、sk、cs相連接。at89818與mcu通過e2tr交換對eeprom的控
74lvt244 74hc244有什么區(qū)別74lvt244 74hc244有什么區(qū)別
74lvt244 74hc244有什么區(qū)別74lvt244 74hc244有什么區(qū)別
周工，問個問題。我以前買的是2104開發(fā)板，現(xiàn)在用的是2132芯片。所以手里沒有2132現(xiàn)成的開發(fā)板或原理圖。現(xiàn)在的板子是我自己根據(jù)你們提供的2132＿2138的說明書畫的。現(xiàn)在我的主要問題是連機連不上。硬件接法是/rtck接了一個4k7的下拉電阻，然后與jtag相連，/rst是jtag與芯片合用，/trst是由復位電路經(jīng)過一片74125產(chǎn)生，然后直接與jtag的相應腳相連，與2104的開發(fā)板一樣，/trst經(jīng)過一片74lvt244后進入芯片引腳。其它的tdi，tdo，tms，tck都是通過這片244的緩沖后與芯片相應管腳相連接的。晶振部分的接法與2104開發(fā)板一樣，一個11.0592mhz的晶振并聯(lián)一個1meg的反饋電阻，外部調(diào)整電容為兩個40pf的電容。現(xiàn)在，我用示波器觀察到的情況是，x1腳的信號為0.8v左右的直流上疊加了0.2v左右的正弦信號，x2腳的信號為0.8v左右的直流上疊加了約0.5v左右的正弦信號。/rtck在上電后保持在2.0v左右，按復位鍵并不能將其拉低。而2132＿2138使用手冊上有這么一句： reset 為低時，p1.26 的低電平使 p1.31:26 復位后用作一個調(diào)試
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