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，對于dsp的運算能力是一種浪費。而在高速數(shù)據(jù)采集方面，fpga有單片機和dsp無法比擬的優(yōu)勢。fpga時鐘頻率高，內(nèi)部時延小；全部控制邏輯由硬件完成，速度快，效率高．因此有圖1所示的系統(tǒng)組成。 2 硬件電路 2．1 高速數(shù)據(jù)采集與存儲電路 為了能夠?qū)ψ饔脮r間為μs級的電火工品的啟爆電流進行實時監(jiān)測，采用了由一些大規(guī)模集成電路芯片構成的高速數(shù)據(jù)采集與存儲電路，如圖2所示。 電火工品無損耗檢測的主要內(nèi)容是對啟爆電流的測量。 電火工品的啟爆電流作用時間為μs級。xcs30是xilinx公司基于sram技術的fpga芯片，由它發(fā)出指令對電容cl充電并啟爆電火工品dt。非接觸式感應線圈作為啟爆電流的探測裝置，取出電壓。前端調(diào)理電路一是擴大可測信號的幅度范圍，設置放大器，對小信號進行放大，以保證足夠的動態(tài)范圍；二是為了不給被測信號帶來影響，輸入端應有較高的輸入阻抗。在實驗中測到的電壓帶有噪聲，于是通過濾波器將噪聲濾掉。但這樣處理以后，信號的驅(qū)動能力下降，以至于a／d不能正確地采樣，于是加了一級跟隨器，增強驅(qū)動能力，這樣a／d就可以正確地采樣了。 xcs30的主要
用為一路32bit數(shù)據(jù)送入fpga中緩存并打包成幀并加入幀號等信息。成幀后的數(shù)據(jù)受主機端程序控制，通過pci接口控制器經(jīng)pci總線送入主存中，根據(jù)需要進行處理或存盤，從而完成數(shù)據(jù)采集過程。 2.2 元器件的選用 adc采用了模擬器件公司(adi)的ad9220子區(qū)式高速adc，分辨率為12bit，采樣率最高為10msps，片內(nèi)帶有高速低噪聲采樣保持放大器和電壓參考源，可以簡化設計。采集卡中所有的控制和時序邏輯全部由一片fpga實現(xiàn)，綜合考慮規(guī)模、速度、功耗等因素，選用了xilinx公司的xcs30。該器件為spartan系列fpga，成本低速度快，可用邏輯門數(shù)為30000門。采樣時鐘發(fā)生器中dds器件選用adi的ad9830單片dds集成電路，其最高時鐘頻率為50mhz，內(nèi)置10bit d/a變換器，頻率控制字長32bit，頻率分辨率可達0.005hz，完全滿足本設計的需要。pci總線控制器選用了cypress公司的cy7c09449（pci-dp），其特點是接口方式靈活，具備pci總線master能力，可以實現(xiàn)與主存或其他slave設備的dma傳輸，這對保證實時高速數(shù)據(jù)采集是十分必要的
據(jù)復用為一路32bit數(shù)據(jù)送入fpga中緩存并打包成幀并加入幀號等信息。成幀后的數(shù)據(jù)受主機端程序控制，通過pci接口控制器經(jīng)pci總線送入主存中，根據(jù)需要進行處理或存盤，從而完成數(shù)據(jù)采集過程。 2.2 元器件的選用 adc采用了模擬器件公司(adi)的ad9220子區(qū)式高速adc，分辨率為12bit，采樣率最高為10msps，片內(nèi)帶有高速低噪聲采樣保持放大器和電壓參考源，可以簡化設計。采集卡中所有的控制和時序邏輯全部由一片fpga實現(xiàn)，綜合考慮規(guī)模、速度、功耗等因素，選用了xilinx公司的xcs30。該器件為spartan系列fpga，成本低速度快，可用邏輯門數(shù)為30000門。采樣時鐘發(fā)生器中dds器件選用adi的ad9830單片dds集成電路，其最高時鐘頻率為50mhz，內(nèi)置10bit d/a變換器，頻率控制字長32bit，頻率分辨率可達0.005hz，完全滿足本設計的需要。pci總線控制器選用了cypress公司的cy7c09449（pci-dp），其特點是接口方式靈活，具備pci總線master能力，可以實現(xiàn)與主存或其他slave設備的dma傳輸，這對保證實時高速數(shù)據(jù)采集是十分必要的
誰有xcs30的multi-ice的解決方案？誰有xcs30的multi-ice的解決方案？
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